1樓：玉碧蓉尉囡
ttl邏輯閘輸入端通過小電阻入地，相當於接低電平；
通過大電阻入地，相當於接高電平；
如果接在vcc上，無論是直接相連、通過小電阻、通過大電阻，都是輸入的高電平；
大電阻指的是大於「開門電阻」，小電阻指的是小於「關門電阻」。
oc門的輸出相「線與」，兩個oc門的輸出只要有一個為0，則輸出就是0，否則為1.
解釋：oc
指的是開集電極輸出，npn三極體發射極接地，從集電極輸出。顯然如果三極體開通，則集電極為0；如果不開通，集電極懸空的話，既不是1也不是0，所以往往要通過外接電阻連到vcc,
兩oc門三極體集電極連在一起，又通過電阻接到vcc,當然是只要一個開通，輸出就是0
沒有畫圖，因為上傳**很可能不能提交，見諒。
望採納。
2樓：赫驪文冒嵐
任何閘電路的輸入端都有輸入阻抗，即內部一般都有上拉電阻，否則閘電路不能識別外部是否有訊號進入。由於有上拉電阻，所以外接對地（gnd）電阻時，就有漏電流經過，這個漏電流會在外接對地電阻上產生一個壓降。
為什麼閘電路的輸入端經過電阻接地其狀態與阻值有關?
3樓：名字好_難取
閘電路輸入端接地時可以看作輸入端到大地之間有微弱電流，所以當接地電阻很大時，接地電阻靠近輸入端那端就會分到一個足夠高的電壓，這時可以看作高電平輸入，同理，當接地電阻過小時，接地電阻靠近輸入端那端分到的電壓就不夠大，視作低電平輸入
4樓：
任何閘電路的輸入端都有輸入阻抗，即內部一般都有上拉電阻，否則閘電路不能識別外部是否有訊號進入。由於有上拉電阻，所以外接對地（gnd）電阻時，就有漏電流經過，這個漏電流會在外接對地電阻上產生一個壓降。
5樓：匿名使用者
樓上答的對，但是我還要補充一點，這個只適合於ttl，對mos管沒有這個結論
6樓：匿名使用者
應為ttl閘電路是由晶體三極體（雙極型半導體）構成的，是一種cccs器件輸入端為發射極，但經過電阻接地時，由於半導體的特性，會產生微弱的電流，從而會產生電勢差。這就是ttl閘電路的輸入負載特性
7樓：陸玥徐孤風
閘電路輸入端接
看作輸入端
間微弱電流所接
電阻接電阻靠近輸入端
端足夠高
電壓看作高電平輸入同理接
電阻接電阻靠近輸入端端電壓
夠視作低電平輸入
為什麼cmos閘電路的輸入端通過電阻接地時，總是相當於低電平
8樓：墨汁諾
就是把輸入端通過電阻接到了地，coms元件是電壓控制的，輸入電流很小（近乎是0），版在電阻上的權
壓差幾乎是0（歐姆定律），也就是電阻兩端電位相等，地就是0電位，就是低電平。
因為cmos電路輸入阻抗很高，輸入端通過電阻接地時，所以相當於低電平。
cmos是高阻抗電路，輸入端通過電阻接地就是把輸入端下拉到低電平，因為這個電阻遠小於輸入阻抗。
9樓：很是感動
因為cmos電路輸入阻抗很高，輸入端通過電阻接地時，所以相當於低電平。
邏輯閘電路 輸入端接電阻問題
10樓：
ttl邏輯閘輸入端通過小電阻入地，相當於接低電平；
通過大電阻入地，相當於回
接高電平；
如果接在vcc上，無論是直接相連、通過小電阻、通過大電阻，都是輸入的高電平；
大電阻指的是大於「開門電阻」，小電阻指的是小於「關門電阻」。
oc門的輸出相「線與」，兩個oc門的輸出只要有一個為0，則輸出就是0，否則為1.
解釋：oc 指的是開集電極輸出，npn三極體發射極接地，從集電極輸出。顯然如果三極體開通，則集電極為0；如答果不開通，集電極懸空的話，既不是1也不是0，所以往往要通過外接電阻連到vcc,
兩oc門三極體集電極連在一起，又通過電阻接到vcc,當然是只要一個開通，輸出就是0
沒有畫圖，因為上傳**很可能不能提交，見諒。
望採納。
11樓：匿名使用者
輸入端接ucc是高電平，接地是低電平。
2. 為什麼cmos閘電路的輸入端通過電阻接地時,總是相當於低電平
12樓：匿名使用者
這個說法不完全正確,要看電阻大小.
電阻不是很大時,接地了,電壓基本為0,自然就是低電平了.
ttl閘電路輸入端通過電阻接地相當於輸入什麼電平
13樓：顧小蝦水瓶
輸入了高電制平。在數字邏bai輯電路中，低du電平表示0，高電平表示1。一般規zhi定低電平為0~dao0.25v，高電平為3.5~5v。
也有其他的可能，如在移動裝置中電池的電壓會隨使用時間的的推移而降低，如果規定高電平最低為3.5v的話可能裝置的使用時間會大大降低，此時規定的高電平電壓會低一點，最低會有1.7v左右。
14樓：墨汁諾
低電平。
輸入端bai(沒有其它訊號du**)通過zhi電阻接dao地或不通過電阻接地均回
為低電平。
ttl輸入端答如果不用，也不要懸空，不接電阻為高電平，但因為是高阻，很容易被幹擾成低電平，一般是通過電阻到地，使之成為低電平或加上拉電阻到電源成為可靠的高電平。
15樓：匿名使用者
ttl輸入端如果不用，也不要懸空，不接電阻為高電平，但因為是高阻，很容易被幹擾成低電平，一般是通過電阻到地，使之成為低電平或加上拉電阻到電源成為可靠的高電平
16樓：陳堅道
輸入端(沒有其它訊號**)通過電阻接地或不通過電阻接地均為低電平。
17樓：宋國真人
因為ttl電路有電流通過，所以當所接的電阻大於2kω時，輸入為高電平，所接電阻小於0.7kω時，輸入為低電平，希望能幫助你！
cmos閘電路的輸入端通過電阻接地總是相當低電平，為什們啊？
18樓：**殘卷
cmos是高阻抗電路，輸入端通過電阻接地就是把輸入端下拉到低電平，因為這個電阻遠小於輸入阻抗。
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