1樓：匿名使用者
1、vhdl語言的特點：功能強大、設計靈活。vhdl具有功能強大的語言結構，可以用簡潔明確的源**來描述複雜的邏輯控制。
它具有多層次的設計描述功能，層層細化，最後可直接生成電路級描述。vhdl支援同步電路、非同步電路和隨機電路的設計，這是其他硬體描述語言雖不能比擬的。vhdl還支援各種設計方法，既支援自底向上的設計，又支援自頂向下的設計；既支援模組化設計，又支援層次化設計。
支援廣泛、易於修改。
關於 賽靈思 軟體**vhdl語言的一個問題
2樓：匿名使用者
我看著好像意思是有一個同步的置位。
一般的reset訊號都是非同步的。很少用同步的復位。內如容果你確實是想要同步復位，那不用管這個warn。可能你的原本意思也是非同步復位，但是你的**中寫錯了。
一般的同步復位就是process的敏感變數中沒有reset。
3樓：匿名使用者
這裡是說你的reset訊號是非同步復位的，不是同步，有沒有影響，就看你自己需要了，看看**結果正確與否就知道了。
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