1樓：
好好讀讀時序圖，我剛開始總是讀錯一位，注意在sh/ld為低電平的鎖存後，再變為高電平的時候，8個輸入口的最高位已經在qh了，就是說第一位的資料是不需要時鐘上升沿的，我是用verilog寫的，c程式見下
*函式功能：讀74ls165的埠 *
*入口：無 *
*出口：read_data *
uint read_int165(void)
clk=0;
asm("nop");
clk=1; //上升沿
asm("nop");
}return read_data;}
2樓：做而論道
最好是使用串列埠方式0，很方便的。
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